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Published Date
2006
(60)
Display Type
Objeto de aprendizaje
(60)
Keywords
Electrónica
(60)
http://udcdata.info/042064
(60)
Estructura interna de una unidad aritmético-lógica. Operación lógica A+B más aritmética de la lógica A·(B negado). (Requiere Plataforma MicroCAP 9.0 ó superior)
3.72
309
64
Estructura interna de una unidad aritmético-lógica. Operación aritmética A+A·B negado. (Requiere Plataforma MicroCAP 9.0 ó superior)
3.72
231
69
Estructura interna del codificador sin prioridad. Codificador 8 a 3 activo con nivel alto (I5 e I6). (Requiere Plataforma MicroCAP 9.0 ó superior)
3.72
222
63
Estructura interna de una unidad aritmético-lógica. Operación lógica (A+(B negado))·(A·B). (Requiere Plataforma MicroCAP 9.0 ó superior)
3.72
257
80
Estructura interna del codificador sin prioridad. Codificador 8 a 3 activo con nivel bajo (I4 e I3). (Requiere Plataforma MicroCAP 9.0 ó superior)
3.72
245
60
Estructura interna del codificador sin prioridad (Requiere Plataforma MicroCAP 9.0 ó superior)
1.45
697
130
Estructura interna del sumador total. Asociación serie (Requiere Plataforma MicroCAP 9.0 ó superior)
1.45
613
120
Estructura de un biestable RS-NAND con sincronismo por nivel (Requiere Plataforma MicroCAP 9.0 ó superior)
1.45
595
162
Estructura interna de una unidad aritmético-lógica (Requiere Plataforma MicroCAP 9.0 ó superior)
1.45
812
155
Estructura interna del decodificador (Requiere Plataforma MicroCAP 9.0 ó superior)
1.45
790
135
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